对标AMD、Inte-！中国首个小芯片标准发布

对标AMD、Inte-！中国首个小芯片标准发布

　　对标AMD、Inte-！中国首个小芯片标准发布

电脑芯片 国产,芯片印国旗,国内指纹芯片　　产业迎来一项重要利好，中国首个原生Chiplet 技术标准正式审定发布！

　　电脑芯片 国产,芯片印国旗,国内指纹芯片在12月16日举办的“第二届中国互连技术与产业大会”上，由中国集成电路领域相关企业和专家共同主导制定的《小芯片接口总线技术要求》团体标准正式通过工信部中国电子工业标准化技术协会的审定并发布。

　　对中国芯片产业而言，该团体标准是中国首个小芯片（Chiplet）技术标准，意义十分重大，这无疑是一大好消息。

　　所谓的小芯片（Chiplet）技术，在近两年里收到了业内的热烈关注和探讨。

　　小芯片Chiplet又被称为“芯粒”，Chiplet将复杂芯片拆解成一组具有单独功能的小芯片单元die（裸片），通过die－to－die的结构将模块芯片和底层基础芯片封装组合在一起。

　　为什么小芯片被这么多企业重视呢，原因是因为小芯片Chiplet架构在制程工艺难以进步的情况下，可以实现晶体管密度的突破，因此对于半导体行业来说非常重要。

　　早在2010年，蒋尚义先生提出通过半导体公司连接两颗芯片的方法，区别于传统封装，定义为先进封装 。

　　而AMD是率先将芯粒技术大规模应用于商业产品的公司之一，在第三代锐龙（Ryzen）处理器上AMD便是复用了第二代霄龙（EPYC）处理器的IO Chiplet。直到2019年，国内华为等公司也在产品中使用芯粒技术。

　　在2022年举办的基金委双清论坛上，孙凝晖院士、刘明院士、蒋尚义先生等讨论提出了“集成芯片”概念，也是对芯粒集成芯片的概括和定义。不过，网上也有一些值得关注的观点。清华大学魏少军教授指出，Chiplet处理器芯片是先进制造工艺的“补充”，而不是替代品。“其目标还是在成本可控情况下的异质集成。”

　　据悉，《小芯片接口总线技术要求》描述了CPU、GPU、人工智能芯片、网络处理器和网络交换芯片等应用场景的小芯片接口总线（chip－let）技术要求，包括总体概述、接口要求、链路层、适配层、物理层和封装要求等。

　　·采用 串行差分 信号相连，多用于 AI、Switch 芯片性能扩展的场景。

　　·C2O （Computing to Others），计算芯片与信号处理、基带单元等其他小芯片的互连。

　　此标准列出了并行总线等三种接口，提出了多种速率要求，总连接带宽可以达到 1．6Tbps，以灵活应对不同的应用场景以及不同能力的技术供应商，通过对链路层、适配层、物理层的详细定义，实现在小芯片之间的互连互通，并兼顾了 PCIe 等现有协议的支持，列出了对封装方式的要求，小芯片设计不但可以使用国际先进封装方式，也可以充分利用国内封装技术积累。

　　换个角度来看，小芯片Chiplet技术其实就是模块化的芯片技术，可以由多个不同制程、架构、功能的小芯片堆叠出全功能芯片，在半导体行业已经极为常见。此次中国发布原生Chiplet小芯片标准，无疑将推动本土半导体芯片这一领域的发展。

　　Chiplego首席技术顾问曾在《揭秘后摩时代芯片产业方向：Chiplet技术》一文中提到，在不考虑制造成本的情况下，人们总是认为单片SOC可以比Chiplet SOC提供更好的性能和功耗。事实上，单片SOC中每个模块都能以最小的延迟进行通信，这使得前者比Chiplet SOC的性能更好。然而，如果把制造成本作为一个芯片设计目标，那么有些单片SOC设计可能会成为一个不可能完成的任务。

　　他以AMD的64核Chiplet芯片设计为例：在7nm技术中，CPU Chiplet尺寸约为81mm＾2；在12nm技术中，I／O芯片的尺寸约为125mm＾2。如果采取单片设计方法，单片SOC的裸片尺寸应该在700mm＾2到800mm＾2之间。

　　而在目前的EUV曝光机中，光掩模版尺寸约为858mm＾2。在未来的High－NA EUV中，光掩模版可能会小于450mm＾2。因此，无论采用哪种情况，AMD 64核SOC的单片设计都难以生产，即使单片设计能提供卓越的性能和功耗。如果人们仍然想以单片SOC中完成64个CPU Core的设计，只有通过减少高速缓存的大小，比如缩减一半甚至更多，这样芯片尺寸就可以减少一半，单片SOC在7nm中可以达到400mm＾2左右，但这种设计方案在生产成本方面并不合理。总而言之，在一个系统中，不同的功能和特性所需要的工艺技术往往是不兼容的。例如，DRAM和RF工艺技术与逻辑SOC就不兼容。在这种情况下，单片SOC是不可能的。如果想把这些功能块集成到一个封装中，Chiplet SOC是唯一的解决方案。

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